基材	銅	層數(shù)	多面
絕緣層厚度	常規(guī)板	絕緣材料	有機樹脂
絕緣樹脂	環(huán)氧樹脂（EP）	阻燃特性	VO板

光模塊PCB板工廠,FPC柔性板

高速PCB設(shè)計指南之二
第二篇 PCB布局

在設(shè)計中，布局是一個重要的環(huán)節(jié)。布局結(jié)果的好壞將直接影響布線的效果，因此可以這樣認為，合理的布局是PCB設(shè)計成功的第一步。
布局的方式分兩種，一種是交互式布局，另一種是自動布局，一般是在自動布局的基礎(chǔ)上用交互式布局進行調(diào)整，在布局時還可根據(jù)走線的情況對門電路進行再分配，將兩個門電路進行交換，使其成為便于布線的最佳布局。在布局完成后，還可對設(shè)計文件及有關(guān)信息進行返回標注于原理圖，使得PCB板中的有關(guān)信息與原理圖相一致，以便在今后的建檔、更改設(shè)計能同步起來, 同時對模擬的有關(guān)信息進行更新，使得能對電路的電氣性能及功能進行板級驗證。

--考慮整體美觀
一個產(chǎn)品的成功與否，一是要注重內(nèi)在質(zhì)量，二是兼顧整體的美觀，兩者都較完美才能認為該產(chǎn)品是成功的。
在一個PCB板上，元件的布局要求要均衡，疏密有序，不能頭重腳輕或一頭沉。

--布局的檢查印制板尺寸是否與加工圖紙尺寸相符？能否符合PCB制造工藝要求？有無定位標記？
元件在二維、三維空間上有無沖突？
元件布局是否疏密有序，排列整齊？是否全部布完？
需經(jīng)常更換的元件能否方便的更換？插件板插入設(shè)備是否方便？
熱敏元件與發(fā)熱元件之間是否有適當?shù)木嚯x？
調(diào)整可調(diào)元件是否方便？
在需要散熱的地方，裝了散熱器沒有？空氣流是否通暢？
信號流程是否順暢且互連最短？
插頭、插座等與機械設(shè)計是否矛盾？
線路的干擾問題是否有所考慮？

高速PCB設(shè)計指南之三
第三篇 高速PCB設(shè)計

（一）、電子系統(tǒng)設(shè)計所面臨的挑戰(zhàn)

　　隨著系統(tǒng)設(shè)計復(fù)雜性和集成度的大規(guī)模提高，電子系統(tǒng)設(shè)計師們正在從事100MHZ以上的電路設(shè)計，總線的工作頻率也已經(jīng)達到或者超過50MHZ，有的甚至超過100MHZ。目前約50% 的設(shè)計的時鐘頻率超過50MHz，將近20% 的設(shè)計主頻超過120MHz。
　　當系統(tǒng)工作在50MHz時，將產(chǎn)生傳輸線效應(yīng)和信號的完整性問題；而當系統(tǒng)時鐘達到120MHz時，除非使用高速電路設(shè)計知識，否則基于傳統(tǒng)方法設(shè)計的PCB將無法工作。因此，高速電路設(shè)計技術(shù)已經(jīng)成為電子系統(tǒng)設(shè)計師必須采取的設(shè)計手段。只有通過使用高速電路設(shè)計師的設(shè)計技術(shù)，才能實現(xiàn)設(shè)計過程的可控性。


（二）、什么是高速電路

　　通常認為如果數(shù)字邏輯電路的頻率達到或者超過45MHZ~50MHZ，而且工作在這個頻率之上的電路已經(jīng)占到了整個電子系統(tǒng)一定的份量（比如說１／３），就稱為高速電路。
　　實際上，信號邊沿的諧波頻率比信號本身的頻率高，是信號快速變化的上升沿與下降沿（或稱信號的跳變）引發(fā)了信號傳輸?shù)姆穷A(yù)期結(jié)果。因此，通常約定如果線傳播延時大于1/2數(shù)字信號驅(qū)動端的上升時間，則認為此類信號是高速信號并產(chǎn)生傳輸線效應(yīng)。
信號的傳遞發(fā)生在信號狀態(tài)改變的瞬間，如上升或下降時間。信號從驅(qū)動端到接收端經(jīng)過一段固定的時間，如果傳輸時間小于1/2的上升或下降時間，那么來自接收端的反射信號將在信號改變狀態(tài)之前到達驅(qū)動端。反之，反射信號將在信號改變狀態(tài)之后到達驅(qū)動端。如果反射信號很強，疊加的波形就有可能會改變邏輯狀態(tài)。
（三）、高速信號的確定

　　上面我們定義了傳輸線效應(yīng)發(fā)生的前提條件，但是如何得知線延時是否大于1/2驅(qū)動端的信號上升時間？一般地，信號上升時間的典型值可通過器件手冊給出，而信號的傳播時間在PCB設(shè)計中由實際布線長度決定。下圖為信號上升時間和允許的布線長度(延時)的對應(yīng)關(guān)系?！?br /> PCB 板上每單位英寸的延時為 0.167ns.。但是，如果過孔多，器件管腳多，網(wǎng)線上設(shè)置的約束多，延時將增大。通常高速邏輯器件的信號上升時間大約為0.2ns。如果板上有GaAs芯片，則最大布線長度為7.62mm。
設(shè)Tr為信號上升時間， Tpd 為信號線傳播延時。如果Tr≥4Tpd，信號落在安全區(qū)域。如果2Tpd≥Tr≥4Tpd，信號落在不確定區(qū)域。如果Tr≤2Tpd，信號落在問題區(qū)域。對于落在不確定區(qū)域及問題區(qū)域的信號，應(yīng)該使用高速布線方法。

（四）、什么是傳輸線

PCB板上的走線可等效為下圖所示的串聯(lián)和并聯(lián)的電容、電阻和電感結(jié)構(gòu)。串聯(lián)電阻的典型值0.25-0.55 ohms/foot，因為絕緣層的緣故，并聯(lián)電阻阻值通常很高。將寄生電阻、電容和電感加到實際的PCB連線中之后，連線上的最終阻抗稱為特征阻抗Zo。線徑越寬，距電源/地越近，或隔離層的介電常數(shù)越高，特征阻抗就越小。如果傳輸線和接收端的阻抗不匹配，那么輸出的電流信號和信號最終的穩(wěn)定狀態(tài)將不同，這就引起信號在接收端產(chǎn)生反射，這個反射信號將傳回信號發(fā)射端并再次反射回來。隨著能量的減弱反射信號的幅度將減小，直到信號的電壓和電流達到穩(wěn)定。這種效應(yīng)被稱為振蕩，信號的振蕩在信號的上升沿和下降沿經(jīng)?？梢钥吹?。



（五）、傳輸線效應(yīng)

基于上述定義的傳輸線模型，歸納起來，傳輸線會對整個電路設(shè)計帶來以下效應(yīng)。
· 反射信號Reflected signals
· 延時和時序錯誤Delay & Timing errors
· 多次跨越邏輯電平門限錯誤False Switching
· 過沖與下沖Overshoot/Undershoot
· 串擾Induced Noise (or crosstalk)
· 電磁輻射EMI radiation

5.1 反射信號
　　如果一根走線沒有被正確終結(jié)(終端匹配)，那么來自于驅(qū)動端的信號脈沖在接收端被反射，從而引發(fā)不預(yù)期效應(yīng)，使信號輪廓失真。當失真變形非常顯著時可導(dǎo)致多種錯誤，引起設(shè)計失敗。同時，失真變形的信號對噪聲的敏感性增加了，也會引起設(shè)計失敗。如果上述情況沒有被足夠考慮，EMI將顯著增加，這就不單單影響自身設(shè)計結(jié)果，還會造成整個系統(tǒng)的失敗。
反射信號產(chǎn)生的主要原因：過長的走線；未被匹配終結(jié)的傳輸線，過量電容或電感以及阻抗失配。


5.2 延時和時序錯誤
　　信號延時和時序錯誤表現(xiàn)為：信號在邏輯電平的高與低門限之間變化時保持一段時間信號不跳變。過多的信號延時可能導(dǎo)致時序錯誤和器件功能的混亂。
　　通常在有多個接收端時會出現(xiàn)問題。電路設(shè)計師必須確定最壞情況下的時間延時以確保設(shè)計的正確性。信號延時產(chǎn)生的原因：驅(qū)動過載，走線過長。

5.3 多次跨越邏輯電平門限錯誤
信號在跳變的過程中可能多次跨越邏輯電平門限從而導(dǎo)致這一類型的錯誤。多次跨越邏輯電平門限錯誤是信號振蕩的一種特殊的形式，即信號的振蕩發(fā)生在邏輯電平門限附近，多次跨越邏輯電平門限會導(dǎo)致邏輯功能紊亂。反射信號產(chǎn)生的原因：過長的走線，未被終結(jié)的傳輸線，過量電容或電感以及阻抗失配。

5.4 過沖與下沖
過沖與下沖來源于走線過長或者信號變化太快兩方面的原因。雖然大多數(shù)元件接收端有輸入保護二極管保護，但有時這些過沖電平會遠遠超過元件電源電壓范圍，損壞元器件。

5.5 串擾
　　串擾表現(xiàn)為在一根信號線上有信號通過時，在PCB板上與之相鄰的信號線上就會感應(yīng)出相關(guān)的信號，我們稱之為串擾。
　　信號線距離地線越近，線間距越大，產(chǎn)生的串擾信號越小。異步信號和時鐘信號更容易產(chǎn)生串擾。因此解串擾的方法是移開發(fā)生串擾的信號或屏蔽被嚴重干擾的信號。
5.6 電磁輻射
EMI(Electro-Magnetic Interference)即電磁干擾，產(chǎn)生的問題包含過量的電磁輻射及對電磁輻射的敏感性兩方面。EMI表現(xiàn)為當數(shù)字系統(tǒng)加電運行時，會對周圍環(huán)境輻射電磁波，從而干擾周圍環(huán)境中電子設(shè)備的正常工作。它產(chǎn)生的主要原因是電路工作頻率太高以及布局布線不合理。目前已有進行 EMI仿真的軟件工具，但EMI仿真器都很昂貴，仿真參數(shù)和邊界條件設(shè)置又很困難，這將直接影響仿真結(jié)果的準確性和實用性。最通常的做法是將控制EMI的各項設(shè)計規(guī)則應(yīng)用在設(shè)計的每一環(huán)節(jié)，實現(xiàn)在設(shè)計各環(huán)節(jié)上的規(guī)則驅(qū)動和控制。


（六）、避免傳輸線效應(yīng)的方法
針對上述傳輸線問題所引入的影響，我們從以下幾方面談?wù)効刂七@些影響的方法。

6.1 嚴格控制關(guān)鍵網(wǎng)線的走線長度
　　如果設(shè)計中有高速跳變的邊沿，就必須考慮到在PCB板上存在傳輸線效應(yīng)的問題。現(xiàn)在普遍使用的很高時鐘頻率的快速集成電路芯片更是存在這樣的問題。解決這個問題有一些基本原則：如果采用CMOS或TTL電路進行設(shè)計，工作頻率小于10MHz，布線長度應(yīng)不大于7英寸。工作頻率在50MHz布線長度應(yīng)不大于1.5英寸。如果工作頻率達到或超過75MHz布線長度應(yīng)在1英寸。對于GaAs芯片最大的布線長度應(yīng)為0.3英寸。如果超過這個標準，就存在傳輸線的問題。

6.2 合理規(guī)劃走線的拓撲結(jié)構(gòu)
　　解決傳輸線效應(yīng)的另一個方法是選擇正確的布線路徑和終端拓撲結(jié)構(gòu)。走線的拓撲結(jié)構(gòu)是指一根網(wǎng)線的布線順序及布線結(jié)構(gòu)。當使用高速邏輯器件時，除非走線分支長度保持很短，否則邊沿快速變化的信號將被信號主干走線上的分支走線所扭曲。通常情形下，PCB走線采用兩種基本拓撲結(jié)構(gòu)，即菊花鏈(Daisy Chain)布線和星形(Star)分布。
　　對于菊花鏈布線，布線從驅(qū)動端開始，依次到達各接收端。如果使用串聯(lián)電阻來改變信號特性，串聯(lián)電阻的位置應(yīng)該緊靠驅(qū)動端。在控制走線的高次諧波干擾方面，菊花鏈走線效果最好。但這種走線方式布通率最低，不容易100%布通。實際設(shè)計中，我們是使菊花鏈布線中分支長度盡可能短，安全的長度值應(yīng)該是：Stub Delay <= Trt *0.1.
　　例如，高速TTL電路中的分支端長度應(yīng)小于1.5英寸。這種拓撲結(jié)構(gòu)占用的布線空間較小并可用單一電阻匹配終結(jié)。但是這種走線結(jié)構(gòu)使得在不同的信號接收端信號的接收是不同步的。
　　星形拓撲結(jié)構(gòu)可以有效的避免時鐘信號的不同步問題，但在密度很高的PCB板上手工完成布線十分困難。采用自動布線器是完成星型布線的最好的方法。每條分支上都需要終端電阻。終端電阻的阻值應(yīng)和連線的特征阻抗相匹配。這可通過手工計算，也可通過CAD工具計算出特征阻抗值和終端匹配電阻值。　

　　在上面的兩個例子中使用了簡單的終端電阻，實際中可選擇使用更復(fù)雜的匹配終端。第一種選擇是RC匹配終端。RC匹配終端可以減少功率消耗，但只能使用于信號工作比較穩(wěn)定的情況。這種方式最適合于對時鐘線信號進行匹配處理。其缺點是RC匹配終端中的電容可能影響信號的形狀和傳播速度。
　　串聯(lián)電阻匹配終端不會產(chǎn)生額外的功率消耗，但會減慢信號的傳輸。這種方式用于時間延遲影響不大的總線驅(qū)動電路。　　串聯(lián)電阻匹配終端的優(yōu)勢還在于可以減少板上器件的使用數(shù)量和連線密度。
　　最后一種方式為分離匹配終端，這種方式匹配元件需要放置在接收端附近。其優(yōu)點是不會拉低信號，并且可以很好的避免噪聲。典型的用于TTL輸入信號(ACT,HCT, FAST)。
　　此外，對于終端匹配電阻的封裝型式和安裝型式也必須考慮。通常SMD表面貼裝電阻比通孔元件具有較低的電感，所以SMD封裝元件成為首選。如果選擇普通直插電阻也有兩種安裝方式可選：垂直方式和水平方式。
　　垂直安裝方式中電阻的一條安裝管腳很短，可以減少電阻和電路板間的熱阻，使電阻的熱量更加容易散發(fā)到空氣中。但較長的垂直安裝會增加電阻的電感。水平安裝方式因安裝較低有更低的電感。但過熱的電阻會出現(xiàn)漂移，在最壞的情況下電阻成為開路，造成PCB走線終結(jié)匹配失效，成為潛在的失敗因素。

6.3 抑止電磁干擾的方法
　　很好地解決信號完整性問題將改善PCB板的電磁兼容性(EMC)。其中非常重要的是保證PCB板有很好的接地。對復(fù)雜的設(shè)計采用一個信號層配一個地線層是十分有效的方法。此外，使電路板的最外層信號的密度最小也是減少電磁輻射的好方法，這種方法可采用"表面積層"技術(shù)"Build-up"設(shè)計制做PCB來實現(xiàn)。表面積層通過在普通工藝 PCB 上增加薄絕緣層和用于貫穿這些層的微孔的組合來實現(xiàn)，電阻和電容可埋在表層下，單位面積上的走線密度會增加近一倍，因而可降低 PCB的體積。PCB面積的縮小對走線的拓撲結(jié)構(gòu)有巨大的影響，這意味著縮小的電流回路，縮小的分支走線長度，而電磁輻射近似正比于電流回路的面積；同時小體積特征意味著高密度引腳封裝器件可以被使用，這又使得連線長度下降，從而電流回路減小，提高電磁兼容特性。

6.4 其它可采用技術(shù)
　　為減小集成電路芯片電源上的電壓瞬時過沖，應(yīng)該為集成電路芯片添加去耦電容。這可以有效去除電源上的毛刺的影響并減少在印制板上的電源環(huán)路的輻射。
　　當去耦電容直接連接在集成電路的電源管腿上而不是連接在電源層上時，其平滑毛刺的效果最好。這就是為什么有一些器件插座上帶有去耦電容，而有的器件要求去耦電容距器件的距離要足夠的小。
　　任何高速和高功耗的器件應(yīng)盡量放置在一起以減少電源電壓瞬時過沖。
　　如果沒有電源層，那么長的電源連線會在信號和回路間形成環(huán)路，成為輻射源和易感應(yīng)電路。
　　走線構(gòu)成一個不穿過同一網(wǎng)線或其它走線的環(huán)路的情況稱為開環(huán)。如果環(huán)路穿過同一網(wǎng)線其它走線則構(gòu)成閉環(huán)。兩種情況都會形成天線效應(yīng)(線天線和環(huán)形天線)。天線對外產(chǎn)生EMI輻射，同時自身也是敏感電路。閉環(huán)是一個必須考慮的問題，因為它產(chǎn)生的輻射與閉環(huán)面積近似成正比。

結(jié)束語
　　　　高速電路設(shè)計是一個非常復(fù)雜的設(shè)計過程。本文所闡述的方法就是專門針對解決這些高速電路設(shè)計問題的。此外，在進行高速電路設(shè)計時有多個因素需要加以考慮，這些因素有時互相對立。如高速器件布局時位置靠近，雖可以減少延時，但可能產(chǎn)生串擾和顯著的熱效應(yīng)。因此在設(shè)計中，需權(quán)衡各因素，做出全面的折衷考慮；既滿足設(shè)計要求，又降低設(shè)計復(fù)雜度。高速PCB設(shè)計手段的采用構(gòu)成了設(shè)計過程的可控性，只有可控的，才是可靠的，也才能是成功的！

深圳市賽孚電路科技有限公司成立于2011年，公司由多名電路板行業(yè)的專家級人士創(chuàng)建，是國內(nèi)專業(yè)高效的PCB/FPC快件服務(wù)商之一。公司成立以來，一直專注樣品，中小批量領(lǐng)域?？焖俚慕桓兑约斑^硬的產(chǎn)品品質(zhì)贏得了國內(nèi)外客戶的信任。公司是廣東電路板行業(yè)協(xié)會會員企業(yè)，是深圳高新技術(shù)認證企業(yè)。擁有完善的質(zhì)量管理體系，先后通過了ISO9001、ISO14000、TS16949、UL、RoHS認證。公司目前擁有員工300余人，廠房面積9000平米，月出貨品種6000種以上，年生產(chǎn)能力為150000平方米。為了滿足客戶多樣化需求，2017年公司成立了PCBA事業(yè)部，自有SMT生產(chǎn)線，為客戶提供PCB+SMT一站式服務(wù)。 公司一直致力于“打造中國優(yōu)秀的PCB制造企業(yè)”。注重人才培養(yǎng)，倡導(dǎo)全員“自我經(jīng)營”理念，擁有一支朝氣蓬勃、專業(yè)敬業(yè)、經(jīng)驗豐富的技術(shù)、生產(chǎn)及管理隊伍；專注于PCB的工藝技術(shù)的研究與開發(fā)，努力提升公司在PCB專業(yè)領(lǐng)域內(nèi)的技術(shù)水平和制造能力.

? ? ? 公司產(chǎn)品廣泛應(yīng)用于通信、工業(yè)控制、計算機應(yīng)用、航空航天、軍工、醫(yī)療、測試儀器、電源等各個領(lǐng)域。我們的產(chǎn)品包括：高多層PCB、HDI PCB、PCB高頻板、軟硬結(jié)合板、FPC等特種高難度電路板，專注于多品種，中小批量領(lǐng)域。我們的客戶分布全球各地，目前外銷訂單占比70%以上。

賽孚電路秉承“以人為本，客戶至上”的企業(yè)經(jīng)營理念，“以質(zhì)量為根，服務(wù)為本 ” 的企業(yè)服務(wù)宗旨，堅持持之以恒的精神，全員參與質(zhì)量改進，不斷吸納國際最新技術(shù)，完善產(chǎn)品品質(zhì)，積極吸引和培養(yǎng)高級管理及技術(shù)人才，以確保向客戶提供更好的服務(wù)，為客戶創(chuàng)造更多價值，與客戶共同成長。